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Inkrementelles SAT und SMT für skalierbare Verifikation

Incremental SAT and SMT Reasoning for Scalable Verification

Katalin Fazekas (ORCID: 0000-0002-0497-3059)
  • Grant-DOI 10.55776/T1306
  • Förderprogramm Hertha Firnberg
  • Status beendet
  • Projektbeginn 01.10.2021
  • Projektende 30.09.2024
  • Bewilligungssumme 246.120 €

Wissenschaftsdisziplinen

Informatik (75%); Mathematik (25%)

Keywords

    Decision Procedures, Automated Reasoning, Formal Verification, Satisfiability, Satisfiability Modulo Theories, Model Checking

Abstract Endbericht

Computer, Telefone, Smart Devices und die darauf laufenden Anwendungen (Apps) sind allgegenwärtig und begleiten uns rund um die Uhr. Diese Technologien sind zu einem wesentlichen Bestandteil unseres täglichen Lebens geworden, daher ist es sehr wichtig, sicherzustellen, dass sie immer wie vorgesehen funktionieren. Formale Verifikation bietet Techniken, um zu zeigen, dass sich ein Hardware- oder Softwaresystem unter allen möglichen Umständen genau so verhält, wie es ursprünglich geplant war. Viele dieser Verifikationstechniken, zum Beispiel Model Checking oder symbolische Ausführung, müssen wiederholt logische Probleme lösen, die sich sehr ähnlich sind, um die Korrektheit eines Systems zu zeigen oder zu widerlegen. Der Fokus dieses Projekts liegt auf diesen zugrunde liegenden logischen Problemen. Inkrementelle Lösungsverfahren versuchen, die Ähnlichkeit der auftretenden logischen Probleme auszunutzen, um mit weniger Aufwand Lösungen zu finden. Das Ziel dieses Projekts ist es, verbesserte inkrementelle Lösungsmethoden für unsere logischen Probleme einzuführen und damit die Grenzen formaler Verifikationstechniken zu verschieben.

Wir nutzen moderne Technologie für fast alles - Kommunikation, Transport, Arbeit, Einkaufen, Unterhaltung und mehr. Aber wie können wir sicher sein, dass die Systeme, auf die wir uns verlassen, immer richtig funktionieren? Da wir immer mehr Software und Hardware verwenden, wird es immer wichtiger, sicherzustellen, dass sie korrekt sind. Eine Möglichkeit dies zu erreichen, besteht darin ihr Verhalten mit logischen Formeln zu beschreiben und dann spezialisierte automatisierte Beweissysteme zu verwenden, um zu überprüfen, ob sie in allen möglichen Situationen korrekt funktionieren. Ziel dieses Projekts war es, diese Beweissysteme effizienter, vielseitiger und zuverlässiger zu machen. In den letzten drei Jahren haben wir mehrere wichtige Fortschritte erzielt. Wir haben standardisierte Methoden entwickelt, damit diese Beweissysteme besser zusammenarbeiten, was ihre Nutzung in größeren Systemen erleichtert und ihre zukünftige Entwicklung und Wartung vereinfacht. Wir haben auch neue Techniken entwickelt, um komplexe logische Probleme - wie die Beschreibung von Hardware-Schaltungen - zu vereinfachen, sodass sie effizienter gelöst werden können. Darüber hinaus haben wir einen neuen Ansatz entwickelt, um verteilte Protokolle zu überprüfen - Regelwerke, die es den Komponenten verteilter Systeme ermöglichen, miteinander zu kommunizieren - indem wir ihre eingebauten Symmetrien nutzen. Um das Vertrauen in automatisierte Beweissysteme weiter zu stärken, haben wir neue Methoden implementiert, die sicherstellen, dass die Lösungen, die sie produzieren, korrekt und zuverlässig sind. Diese Verbesserungen fördern die Weiterentwicklung der formalen Verifikation und machen es einfacher und effizienter, nachzuweisen, dass kritische Systeme, wie medizinische Geräte oder selbstfahrende Autos, korrekt und sicher funktionieren. Durch die Verbesserung dieser Verifikationswerkzeuge trägt unsere Forschung dazu bei, alltägliche Technologie zuverlässiger zu machen und das Risiko von Softwarefehlern und Systemausfällen zu verringern.

Forschungsstätte(n)
  • Technische Universität Wien - 100%
Nationale Projektbeteiligte
  • Armin Biere, Albert-Ludwigs-Universität Freiburg , nationale:r Kooperationspartner:in
Internationale Projektbeteiligte
  • Armin Biere, Albert-Ludwigs-Universität Freiburg - Deutschland
  • Aina Niemetz, University of Stanford - Vereinigte Staaten von Amerika
  • Mathias Preiner, University of Stanford - Vereinigte Staaten von Amerika
  • Daniel Kröning, University of Oxford - Vereinigtes Königreich

Research Output

  • 9 Publikationen
  • 3 Software
  • 4 Wissenschaftliche Auszeichnungen
Publikationen
  • 2024
    Titel CaDiCaL 2.0; In: Computer Aided Verification - 36th International Conference, CAV 2024, Montreal, QC, Canada, July 24-27, 2024, Proceedings, Part I
    DOI 10.1007/978-3-031-65627-9_7
    Typ Book Chapter
    Verlag Springer Nature Switzerland
  • 2024
    Titel Satisfiability Modulo User Propagators
    DOI 10.1613/jair.1.16163
    Typ Journal Article
    Autor Fazekas K
    Journal Journal of Artificial Intelligence Research
  • 2024
    Titel Incremental Proofs for Bounded Model Checking
    Typ Other
    Autor Fazekas K
    Konferenz Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen (MBMV)
    Seiten 133-143
    Link Publikation
  • 2024
    Titel Clausal Congruence Closure
    Typ Conference Proceeding Abstract
    Autor Biere A
    Konferenz International Conference on Theory and Applications of Satisfiability Testing (SAT)
    Seiten 6:1-6:25
    Link Publikation
  • 2024
    Titel Certifying Incremental SAT Solving
    Typ Conference Proceeding Abstract
    Autor Fazekas K
    Konferenz Conference on Logic for Programming, Artificial Intelligence and Reasoning
    Seiten 321-340
    Link Publikation
  • 2024
    Titel Clausal equivalence sweeping
    Typ Conference Proceeding Abstract
    Autor Biere A
    Konferenz Formal Methods in Computer-Aided Design (FMCAD)
    Seiten 236-241
    Link Publikation
  • 2023
    Titel IPASIR-UP: User Propagators for CDCL
    Typ Conference Proceeding Abstract
    Autor Fazekas K
    Konferenz International Conference on Theory and Applications of Satisfiability Testing (SAT)
    Seiten 8:1-8:13
    Link Publikation
  • 2023
    Titel SAT-Based Quantified Symmetric Minimization of the Reachable States of Distributed Protocols
    Typ Conference Proceeding Abstract
    Autor Fazekas K
    Konferenz Formal Methods in Computer-Aided Design (FMCAD)
    Seiten 152-161
    Link Publikation
  • 2023
    Titel On Incremental Pre-processing forSMT; In: Automated Deduction - CADE 29 - 29th International Conference on Automated Deduction, Rome, Italy, July 1-4, 2023, Proceedings
    DOI 10.1007/978-3-031-38499-8_3
    Typ Book Chapter
    Verlag Springer Nature Switzerland
Software
  • 2024 Link
    Titel CaDiCaL 2.0 CAV'24 Tool-Paper Artifact
    DOI 10.5281/zenodo.10943124
    Link Link
  • 2024 Link
    Titel Visualizer for LIDRUP proofs
    Link Link
  • 2023 Link
    Titel Supplementary material of submission "IPASIR-UP: User Propagators for CDCL"
    DOI 10.5281/zenodo.8003682
    Link Link
Wissenschaftliche Auszeichnungen
  • 2024
    Titel Invited Lecturer: SAT/SMT/AR Summerschool 2024
    Typ Personally asked as a key note speaker to a conference
    Bekanntheitsgrad Continental/International
  • 2024
    Titel Invited Participant: Dagstuhl Seminar 24421
    Typ Personally asked as a key note speaker to a conference
    Bekanntheitsgrad Continental/International
  • 2023
    Titel Invited Participant: Shonan Meeting
    Typ Personally asked as a key note speaker to a conference
    Bekanntheitsgrad Continental/International
  • 2023
    Titel Invited Speaker at FroCoS 2023
    Typ Personally asked as a key note speaker to a conference
    DOI 10.1007/978-3-031-43369-6
    Bekanntheitsgrad Continental/International

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